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Altera Stratix® 10 FPGA和SoC FPGA

Altera Stratix® 10 FPGA和SoC FPGA在很大程度上提高了性能、功率效率、密度和系统集成度。Altera Stratix 10采用Altera创新的Hyperflex™ FPGA架构，结合了嵌入式多芯片互连桥 (EMIB)、高级接口总线 (AIB) 和芯片组等技术。因此，Altera Stratix 10设备的性能比上一代高性能FPGA高出2倍。

Altera Stratix 10 GX FPGA
设计用于满足高吞吐量系统的高性能要求。

Altera Stratix 10 SX SoC FPGA
采用硬核处理器系统，具有64位四核Arm Cortex-A53处理器。

Altera Stratix 10 TX FPGA
将H形和E形收发器磁片结合在一起，提供业界最先进的收发器功能。

Altera Stratix 10 MX FPGA
高性能计算 (HPC) 用基本多功能加速器。

Altera Stratix 10 DX FPGA
支持Altera Ultra Path互连技术，可与未来特定型号的Altera Xeon可扩展处理器建立一致性连接。

Altera Stratix 10 NX FPGA
设计用于满足高吞吐量系统的高性能要求。

Altera Stratix 10 AX FPGA
通过集成高性能数据转换器提供直接射频功能。

特性

  • 利用2X内核时钟频率性能实现吞吐量突破
  • 采用Altera Hyperflex FPGA架构，可减小IP尺寸，将跨多个器件的设计整合到单个器件中，与上一代器件相比，功耗降低高达70%
  • 通过更快时钟频率降低总线宽度并减小知识产权 (IP) 尺寸，从而腾出额外的FPGA资源以增加功能
  • 提高性能，减少路由拥堵，使用超感知设计工具实现更少设计迭代

应用

  • ASIC原型设计，通过单片FPGA架构降低设计分区复杂性，从而提高效率
  • fMAX超过900MHz，实现以线路速率监控所有支持的协议
  • UPI，统一直连未来部分Altera Xeon可扩展处理器和PCIe Gen4 x16以及Altera Hyperflex FPGA架构、可配置DSP引擎和AI Tensor模块，实现计算吞吐量突破
  • fMAX超过700MHz，采用Altera Hyperflex FPGA架构，支持400G以太网
  • 雷达，符合IEEE 754标准的单精度浮点性能高达8.6 TFLOPS，以较低功耗提供GPU级性能
  • OTN/数据中心互连，包括异构3D系统级封装 (SiP) 集成收发器磁片提供30G背板支持，路径达57.8Gbps和28.9Gbps

规范

  • 四核Arm Cortex–A53 MPCore处理器集群，频率高达1.5GHz
  • 矢量浮点单元 (VFPU) 单精度和双精度Arm Neon媒体处理引擎，用于每个处理器
  • 32KB L1指令缓存（带奇偶校验）、32KB L1数据缓存（带纠错码 (ECC)）
  • 1MB KB共享L2缓存（带ECC）
  • 256KB片上RAM
  • 系统内存管理单元支持统一内存模型，并将硬件虚拟化扩展到在FPGA架构中实现的 外设
  • 提供单向 (I/O) 统一，支持CCU主器件查看Arm Cortex – A53 MPCore CPU的一致性存储器
  • 8通道直接内存访问 (DMA)
  • 3个10/100/1000 EMAC，带集成DMA
  • 2个USB OTG，带集成DMA
  • 2个UART 16550兼容
  • 4个串行外设接口 (SPI) 控制器
  • 5个I2C
  • 1个eMMC 4.5，DMA和CE-ATA支持SD/SDIO/MMC控制器
  • 1个ONFI 1.0或更高版本8和16位支持NAND闪存控制器
  • 最多48个软件可编程GPIO
  • 4个通用定时器、4个看门狗定时器
  • 系统管理器包含内存映射控制和状态寄存器和逻辑，以控制系统级功能和其他HPS模块
  • 重置管理器根据HPS和FPGA架构中源的复位请求重置信号，并将软件写入模块复位控制寄存器
  • 时钟管理器提供软件可编程时钟控制，以配置HPS中生成的所有时钟

SoC FPGA框图

框图 - Altera Stratix® 10 FPGA和SoC FPGA

视频

开发套件

Altera Stratix® 10开发套件

完整的设计环境，用于评估Stratix 10 FPGA的功能。

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Altera Stratix® 10 GX信号完整性开发套件

完整的设计环境，包含开发Stratix® 10 GX FPGA所需的所有软硬件。

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Altera Stratix® 10 TX信号完整性开发套件

完整的设计环境，包含开发Stratix 10 TX FPGA设计所需的所有软硬件。

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Terasic Technologies Stratix® 10 Sensor Processing Kit

High-performance platform designed for real-time sensor data processing and transmission.

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设计软件

Altera Quartus® II 设计软件

多平台设计 环境，可轻松满足您在 FPGA和CPLD 各设计阶段的所有特定需求。

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Altera Fpga AI套件

开发平台，设计用于简化FPGA上AI推理解决方案的创建。

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发布日期: 2023-09-25 | 更新日期: 2026-01-07